数字IC测试
随着Internet的普及,远程教育在我国已有了很大的发展,尤其是CAI课件以及一些教学交互的软件的研究已有相当的程度。然而远程实验的发展却大大落后,这是由于不同领域实验的远程化需要研究不同的实现方法。 在本文中首先阐述了一种高校电子信息类***数字逻辑以及现代可编程器件(FPGA/CPLD)等课程的远程实验系统,在这个系统中使用远程测试(数字IC测试)来实现实实在在的硬件实验,使得这个系统不同于纯软件的。罪魁祸首：SiOHSiOHMOSFET原理是一个门极(Gate)靠静电势控制底下的导电沟道深度，电势高形成深沟道电流就大，电势低沟道消失就不导电了。
接着叙述了该实验系统中虚拟实验环境软件和实验服务提供端的数字IC测试系统的设计。虚拟实验环境软件提供一个可灵活配置、形象直观的实验界面,这个界面为使用者提供了实验的***认识。数字IC测试系统完成实际实验:提供激励并测试响应。本文叙述的数字IC测试系统可对多达96通道的可编程器件进行实验,另外它还作为面向维修的测试仪器,具有在线测试、连线测试、V-I测试、施加上拉电阻、调节门槛比较电平等功能。除了通用的南北桥结构外，目前芯片组正向更的加速集线架构发展，Intel的8xx系列芯片组就是这类芯片组的代表，它将一些子系统如IDE接口、音效、MODEM和USB直接接入主芯片，能够提供比PCI总线宽一倍的带宽，达到了266MB/s。
ESD保护电路的数字逻辑芯片检测
数字电子技术是普通高校电子类相关***的必修课程,主要包含组合逻辑电路和时序逻辑电路两部分内容及其应用。数字电子技术又是一门实践性很强的课程,需要学生动手做实验来加深对数字逻辑芯片工作原理的理解。数字电路实验离不开数字逻辑芯片,很多高校每年都会采购一批数字逻辑芯片,芯片复用率很低,造成了数字逻辑芯片的严重浪费。常常用于芯片Tapeout前的功能验证，或者用于基于FPGA的系统产品（非ASIC实现方案，快速推向市场）。
数字电路实验会使用到许多不同类型的数字逻辑芯片。由于储存方法不当、实验平台不完善、学生不规范操作等原因,数字逻辑芯片经常发生损坏。由于其故障类型多样、检测过程繁琐,因此实验室管理人员难以及时排查故障芯片。本文基于芯片ESD保护原理、故障字典法研究设计了一种数字逻辑芯片自动化检测系统。该系统可检测数字逻辑芯片是否有短路、断路和逻辑功能错误等故障,并可确定具体的故障引脚位置,通过LCD液晶屏或上位机将检测结果展示给用户。经过实际的试验和数据分析可以得出:该检测系统可以较好地检测数字逻辑芯片故障,单枚芯片检测时间大约为3秒,且检测准确率高达99.4%、运行功耗低至0.44W。非常适合在开设数字电子技术课程的高校中推广应用,同时也可用于芯片制造公司的成品检测。但是这两种方式都不可能长时间发生，所以总的来说，芯片是会逐渐老化的。
数字ic设计之综合介绍
在数字IC设计流程中，前端设计工程师，根据SPEC，完成RTL实现之后，有一步非常重要的环节，就是综合，那么什么是综合呢？
综合是一种在众多结构、速度、功能已知的逻辑单元库的基础上，以满足时序、面积、逻辑网络结构为目标的从寄存器传输级（RTL）到门级的映射方案，它将行为级描述，映射成为了要求工艺库下的，标准门单元电路的拓扑连接。
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