ABB SDCS-PIN-25 3BSE005666R1
ABB SDCS-PIN-25 3BSE005666R1
ABB SDCS-PIN-25 3BSE005666R1
专业提供：PLC可编程控制系统，分散控制系统（DCS）安全仪表系统（SIS），ESD系统，振动监测系统，汽轮机控制 压缩机组控制系统（CCS）等各类工控系统部件
系统里的 PLC模块，DCS模块，CPU模块，IO模块，DO模块，AI模块，DI模块，网络通信模块，
以太网模块，运动控制模块，模拟量输入模块，模拟量输出模块，数字输入模块，数字输出模块，
冗余模块，电源模块，继电器输出模块，继电器输入模块，处理器模块
冗余模块，电源模块，继电器输出模块，继电器输入模块，处理器模块
在此架构中，AlteraDDRDRAM控制与写/读wrapper间的数据带宽为64位，而通过wrapper逻辑，更可自由地编写输入与输出带宽。在写/读wrapper中，数据的地址计算采用累进式累加方式，其存取接口类似于FIFO的存取，因而更容易实现大容量数据的存取。
每个wrapper中有一个小容量的FIFO、封装(packing)/反封装(un-packing)机制以及地址累进计数器。FIFO用于调节使用者接口与DRAM频域的差异；封装/反封装机制用于将输入/输出接口数据总线宽度调整至与DRAM控制IP接口相同的水平，以利于提高写入/读出DRAM数据的效率。地址累进计数器是每个wrapper的DRAM地址产生器，只要写入wrapper里的计数器数字大于读出wrapper里的计数器，则所读出的必为先前已经写入DRAM里的合法数据，不会存取到错误地址的数据。
MPMA提高效率
以图2的点P5为例，若不使用wrapper，则此点数据会被写入1次，而在运算的时候被读出1(当作主要运算点)+8(当作参考数据点)次。当一幅有n点数据的图像需要做侦错处理时，则需要n*(1+1+8)次的数据存取，还不包括地址计算所造成的延迟。
当使用一进三出的MPMAwrapper时，P5点只需要被写入1次，而在运算的时候被读出3(3个读wrapper各需要读取1次)次，则同样的n点数据作完侦错处理只需要n*(1+3)次的数据存取，并且采用累进式的DRAM地址计算，不需要花费额外的延迟时间。由此可知，MPMA设计可提高2倍以上的数据存取效率。
结语
本文提出一种架构，在FPGA供货商所提供的IP核上添加写入/读出wrapper，具有数据的高度重复使用率与容易操作的类FIFO接口等优点。设计师更可自行定义MPMAwrapper输入/输出端口的个数与数据总线宽度，以提高数据使用率。
凌华科技已将此技术应用于大数据量的图像采集/处理/传输模块，尤其是线阵扫描(Line-Scan)图像采集系统，因为在检测时，需要在FPGA上执行图像数据计算的算法，一方面需要大容量的图像数据缓存，另一方面需要反复读取图像数据，则此技术是必需的。
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